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公開番号2024046842
公報種別公開特許公報(A)
公開日2024-04-05
出願番号2022152166
出願日2022-09-26
発明の名称半導体装置
出願人株式会社東芝,東芝デバイス&ストレージ株式会社
代理人弁理士法人鈴榮特許綜合事務所
主分類H03K 17/687 20060101AFI20240329BHJP(基本電子回路)
要約【課題】出力電圧を短時間で0Vにする。
【解決手段】実施形態に係る半導体装置は、第1及び第2端子と、第1乃至第4トランジスタと、制御回路とを含む。第1トランジスタは、第1ノードに接続された第1端と、第1端子に接続された第2端とを含む。第2トランジスタは、第2ノードに接続された第1端と、第2端子に接続された第2端とを含む。第3トランジスタは、第1電圧が供給される第3ノードに接続された第1端と、第1ノードに接続された第2端とを含む。第4トランジスタは、第3ノードに接続された第1端と、第2ノードに接続された第2端とを含む。制御回路は、第3ノードへの第1電圧の供給が停止された際に、第2トランジスタをオフ状態からオン状態にし、第3トランジスタ及び第4トランジスタをオン状態からオフ状態にし、第1期間経過後に、第1トランジスタをオフ状態からオン状態にする。
【選択図】図1
特許請求の範囲【請求項1】
第1端子と、
第2端子と、
第1ノードに接続された第1端と、前記第1端子に接続された第2端とを含む第1トランジスタと、
第2ノードに接続された第1端と、前記第2端子に接続された第2端とを含む第2トランジスタと、
第1電圧が供給される第3ノードに接続された第1端と、前記第1ノードに接続された第2端とを含む第3トランジスタと、
前記第3ノードに接続された第1端と、前記第2ノードに接続された第2端とを含む第4トランジスタと、
前記第1トランジスタ、前記第2トランジスタ、前記第3トランジスタ、及び前記第4トランジスタを制御する制御回路と、
を備え、
前記制御回路は、前記第3ノードへの前記第1電圧の供給が停止された際に、前記第2トランジスタをオフ状態からオン状態にし、前記第3トランジスタ及び前記第4トランジスタをオン状態からオフ状態にし、第1期間経過後に、前記第1トランジスタをオフ状態からオン状態にする、
半導体装置。
続きを表示(約 1,300 文字)【請求項2】
第1端子と、
第2端子と、
第1ノードに接続された第1端と、前記第1端子に接続された第2端とを含む第1トランジスタと、
第2ノードに接続された第1端と、前記第2端子に接続された第2端とを含む第2トランジスタと、
第1電圧が供給される第3ノードに接続された第1端と、前記第1ノードに接続された第2端とを含む第3トランジスタと、
前記第3ノードに接続された第1端と、前記第2ノードに接続された第2端とを含む第4トランジスタと、
前記第3ノードに接続された第1端と、前記第3トランジスタのゲートに接続された第2端とを含む第5トランジスタと、
前記第3ノードに接続された第1端と、前記第4トランジスタのゲートに接続された第2端とを含む第6トランジスタと、
を備える、半導体装置。
【請求項3】
前記第3ノードに接続された第1端と、前記第3トランジスタの前記ゲートに接続された第2端とを含む第1抵抗と、
前記第3トランジスタの前記ゲートに接続された第1端を含む第7トランジスタと、
前記第3ノードに接続された第1端と、前記第4トランジスタの前記ゲートに接続された第2端とを含む第2抵抗と、
前記第4トランジスタの前記ゲートに接続された第1端を含む第8トランジスタと、
をさらに備える、請求項2に記載の半導体装置。
【請求項4】
第1端子と、
第2端子と、
第1ノードに接続された第1端と、前記第1端子に接続された第2端とを含む第1トランジスタと、
第2ノードに接続された第1端と、前記第2端子に接続された第2端とを含む第2トランジスタと、
前記第1ノードに接続された第1端を含む第3トランジスタと、
第1電圧が供給される第3ノードに接続された第1端と、前記第3トランジスタの第2端と接続された第2端と、前記第3トランジスタのゲートと接続されたゲートとを含む第4トランジスタと、
前記第3ノードに接続された第1端と、前記第2ノードに接続された第2端とを含む第5トランジスタと、
を備える、半導体装置。
【請求項5】
前記第1端子に接続された第1端と、前記第1ノードに接続されたゲートとを含む第1のN型トランジスタと、
前記第2端子に接続された第1端と、前記第1のN型トランジスタの第2端と接続された第2端と、前記第2ノードに接続されたゲートとを含む第2のN型トランジスタと、
をさらに備える、請求項1乃至4のいずれか1項に記載の半導体装置。
【請求項6】
前記第1ノードに接続された第3端子と、
前記第2ノードに接続された第4端子と、
をさらに備える、請求項1乃至4のいずれか1項に記載の半導体装置。
【請求項7】
前記第1電圧を生成し、生成した前記第1電圧を前記第3ノードに出力するように構成されたチャージポンプ回路をさらに備える、
請求項1乃至4のいずれか1項に記載の半導体装置。

発明の詳細な説明【技術分野】
【0001】
本発明の実施形態は、半導体装置に関する。
続きを表示(約 1,500 文字)【背景技術】
【0002】
負荷に電力を供給するための半導体装置が知られている。
【先行技術文献】
【特許文献】
【0003】
国際公開第2018/110230号
国際公開第2021/024643号
特開2021-48020号公報
特開2021-97324号公報
特開2012-253897号公報
特開平10-154391号公報
【発明の概要】
【発明が解決しようとする課題】
【0004】
出力電圧を短時間で0Vにする。
【課題を解決するための手段】
【0005】
実施形態に係る半導体装置は、第1端子と、第2端子と、第1トランジスタと、第2トランジスタと、第3トランジスタと、第4トランジスタと、制御回路とを含む。第1トランジスタは、第1ノードに接続された第1端と、第1端子に接続された第2端とを含む。第2トランジスタは、第2ノードに接続された第1端と、第2端子に接続された第2端とを含む。第3トランジスタは、第1電圧が供給される第3ノードに接続された第1端と、第1ノードに接続された第2端とを含む。第4トランジスタは、第3ノードに接続された第1端と、第2ノードに接続された第2端とを含む。制御回路は、第1トランジスタ、第2トランジスタ、第3トランジスタ、及び第4トランジスタを制御する。制御回路は、第3ノードへの第1電圧の供給が停止された際に、第2トランジスタをオフ状態からオン状態にし、第3トランジスタ及び第4トランジスタをオン状態からオフ状態にし、第1期間経過後に、第1トランジスタをオフ状態からオン状態にする。
【図面の簡単な説明】
【0006】
第1実施形態に係る半導体装置の構成の一例を説明するための回路図。
第1実施形態に係る半導体装置の動作例を示すタイミングチャート。
比較例に係る半導体装置の動作例を示すタイミングチャート。
第2実施形態に係る半導体装置の構成の一例を説明するための回路図。
第2実施形態に係る半導体装置の動作例を示すタイミングチャート。
第3実施形態に係る半導体装置の構成の一例を説明するための回路図。
第3実施形態に係る半導体装置の動作例を示すタイミングチャート。
変形例に係る半導体装置の構成の一例を説明するための回路図。
【発明を実施するための形態】
【0007】
以下、実施形態につき図面を参照して説明する。説明に際し、略同一の機能及び構成を有する構成要素については、同一符号を付す。また、以下に示す実施形態は、技術的思想を例示するものである。実施形態は、構成部品の材質、形状、構造、配置等を特定するものではない。実施形態は、種々の変更を加えることができる。
【0008】
[1]第1実施形態
第1実施形態に係る半導体装置について説明する。
【0009】
[1-1]構成
[1-1-1]半導体装置1の全体構成
図1は、第1実施形態に係る半導体装置の構成の一例を説明するための回路図である。半導体装置1は、負荷に電力を供給するロードスイッチである。半導体装置1は、例えば、IC(Integrated Circuit)チップである。
【0010】
半導体装置1は、端子PVIN、PVOUT、及びPEN、トランジスタMNO1及びMNO2、制御回路10、チャージポンプ回路20、並びにスイッチング回路31、32、33、及び34を含む。
(【0011】以降は省略されています)

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